LATTICE FPGA 信号被优化问题

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篇首语:本文由小常识网(cha138.com)小编为大家整理,主要介绍了LATTICE FPGA 信号被优化问题相关的知识,希望对你有一定的参考价值。

我用的是LATTICE 公司的DIAMOND 软件进行综合,芯片是ECP3_70EA_484.
最近遇到个棘手的问题,请各位高手指教。就是一个信号在没有加入在线逻辑里在线仿真时怎么都不对,但是一加入进去就都对了。
例如:
if (time_cnt < 100)
begin
a<= b;
end
如果不将time_cnt 加入在线逻辑仿真,下面就怎么都不执行,但是把这个信号加入在线逻辑里面去仿真,就一切都正常了。感觉是好像被优化了,求高手指教怎么解决

在你定义的信号类型面前加上(* keep = "TRUE" *),然后在综合,就不会被优化了。xilinx是这样,你试试! 参考技术A 规范一下数值的写法,100写成7'd100,time_cnt位宽要声明正确,不然很有可能被DIAMOND优化掉;优化掉会在综合的时候报warning。

以上是关于LATTICE FPGA 信号被优化问题的主要内容,如果未能解决你的问题,请参考以下文章

lattice与altera的fpga有啥区别?譬如开发环境,配置等

FPGA 手动布线和防止优化的问题

V3学院带你学习-如何让chipscope里面的信号不被优化掉

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