FPGA 关于中间环节生成时钟的约束---Generated clocks
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FPGA 关于中间环节生成时钟的约束---Generated clocks
FPGA 的生成时钟，有一个主时钟源，在定义的之后，需要指明主时钟源。
生成时钟主要定义的是：分频，倍频，相移等
二分频时钟定义：
相移时钟定义：
forward clock 定义：
自动生成时钟：
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