使用Tcl脚本分配FPGA管脚

Posted lcchuguo

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篇首语:本文由小常识网(cha138.com)小编为大家整理,主要介绍了使用Tcl脚本分配FPGA管脚相关的知识,希望对你有一定的参考价值。

自己主动生成Tcl文件

Project -> Generate Tcl File for Project...

弹出例如以下对话框。设置脚本路径。

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编辑引脚

使用set_location_assignment分配管脚例如以下:

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第一次配制时。没有set_location_assignment语句,自已在set_global_assignment语句下一行加入就可以。

运行Tcl脚本

Tools -> Tcl Scripts...

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选中刚新建的Tcl文件,点击Run执行就可以!

答疑解惑

1. 为什么Tcl中没有为每一个引脚分配输入输出属性。也能保证引脚属性正确?

由于引脚输入输出属性都已经在Verilog语言的module中或原理图中设置了。例如以下图,

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以上是关于使用Tcl脚本分配FPGA管脚的主要内容,如果未能解决你的问题,请参考以下文章

FPGA管脚分配文件保存方法

Verilog通过文件去定义管脚?

在Quartus中如何使用TCL脚本文件配制管脚

如何分配FPGA管脚

Quartus II管脚批量分配文件(.tcl)格式

如何利用TCL文件给FPGA分配引脚