FPGA EP3C16F484C芯片 上电后管脚输出一个200ms左右的高脉冲， 怎样消除？ 在quartus II 哪设置吗?
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不能设置，只能通过该脚下拉电阻到地解决。因为上电到FPGA配置完成期间，FPGA内部默认弱上拉。 参考技术A 你把没用的管脚设置成三态了吗？追问是的啊 unused pins --------- as input tri-stated
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