Verilog写入变量值到文件语句
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篇首语：本文由小常识网(cha138.com)小编为大家整理，主要介绍了Verilog写入变量值到文件语句相关的知识，希望对你有一定的参考价值。
integer signed fid_out1,fid_out2;
initial
begin
fid_out1 = $fopen("dataout_i.txt","w");
fid_out2 = $fopen("dataout_q.txt","w");
end
always @(posedge clk)
begin
if(out_flag)
begin
$fdisplay(fid_out1,"%d",data_I);
$fdisplay(fid_out2,"%d",data_Q);
end
end
以上是关于Verilog写入变量值到文件语句的主要内容，如果未能解决你的问题，请参考以下文章