应聘，电气类 自动化类 笔试题目

Posted 2023-04-10

谁有电气类和自动化类的应聘笔试题目和资料？
谢谢帮助！
我要应聘的是钛金属加工及铸造公司

　　数字电路
　　1、同步电路和异步电路的区别是什么？（仕兰微电子）
　　2、什么是同步逻辑和异步逻辑？（汉王笔试）
　　同步逻辑是时钟之间有固定的因果关系。异步逻辑是各时钟之间没有固定的因果关系。
　　3、什么是"线与"逻辑，要实现它，在硬件特性上有什么具体要求？（汉王笔试）
　　线与逻辑是两个输出信号相连可以实现与的功能。在硬件上，要用oc门来实现，由于不用 oc门可能使灌电流过大，而烧坏逻辑门。 同时在输出端口应加一个上拉电阻。
　　4、什么是Setup 和Holdup时间？（汉王笔试）
　　5、setup和holdup时间,区别.（南山之桥）
　　6、解释setup time和hold time的定义和在时钟信号延迟时的变化。（未知）
　　7、解释setup和hold time violation，画图说明，并说明解决办法。（威盛VIA
　　2003.11.06 上海笔试试题）
　　Setup/hold time 是测试芯片对输入信号和时钟信号之间的时间要求。建立时间是指触发 器的时钟信号上升沿到来以前，数据稳定不变的时间。输入信号应提前时钟上升沿（如上升沿有效）T时间到达芯片，这个T就是建立时间-Setup time.如不满足setup time,这个数据就不能被这一时钟打入触发器，只有在下一个时钟上升沿，数据才能被打入触发器。 保持时间是指触发器的时钟信号上升沿到来以后，数据稳定不变的时间。如果hold time 不够，数据同样不能被打入触发器。
　　建立时间(Setup Time)和保持时间（Hold time）。建立时间是指在时钟边沿前，数据信 号需要保持不变的时间。保持时间是指时钟跳变边沿后数据信号需要保持不变的时间。如果不满足建立和保持时间的话，那么DFF将不能正确地采样到数据，将会出现 metastability的情况。如果数据信号在时钟沿触发前后持续的时间均超过建立和保持时 间，那么超过量就分别被称为建立时间裕量和保持时间裕量。
　　8、说说对数字逻辑中的竞争和冒险的理解，并举例说明竞争和冒险怎样消除。（仕兰微 电子）
　　9、什么是竞争与冒险现象？怎样判断？如何消除？（汉王笔试）
　　在组合逻辑中，由于门的输入信号通路中经过了不同的延时，导致到达该门的时间不一致叫竞争。产生毛刺叫冒险。如果布尔式中有相反的信号则可能产生竞争和冒险现象。解决方法：一是添加布尔式的消去项，二是在芯片外部加电容。
　　10、你知道那些常用逻辑电平？TTL与COMS电平可以直接互连吗？（汉王笔试）
　　常用逻辑电平：12V，5V，3.3V；TTL和CMOS不可以直接互连，由于TTL是在0.3-3.6V之间，而CMOS则是有在12V的有在5V的。CMOS输出接到TTL是可以直接互连。TTL接到CMOS需要在输出端口加一上拉电阻接到5V或者12V。
　　11、如何解决亚稳态。（飞利浦－大唐笔试）
　　亚稳态是指触发器无法在某个规定时间段内达到一个可确认的状态。当一个触发器进入亚
　　稳态时，既无法预测该单元的输出电平，也无法预测何时输出才能稳定在某个正确的电平
　　上。在这个稳定期间，触发器输出一些中间级电平，或者可能处于振荡状态，并且这种无
　　用的输出电平可以沿信号通道上的各个触发器级联式传播下去。
　　12、IC设计中同步复位与 异步复位的区别。（南山之桥）
　　13、MOORE 与 MEELEY状态机的特征。（南山之桥）
　　14、多时域设计中,如何处理信号跨时域。（南山之桥）
　　15、给了reg的setup,hold时间，求中间组合逻辑的delay范围。（飞利浦－大唐笔试）
　　Delay < period - setup – hold
　　16、时钟周期为T,触发器D1的建立时间最大为T1max，最小为T1min。组合逻辑电路最大延
　　迟为T2max,最小为T2min。问，触发器D2的建立时间T3和保持时间应满足什么条件。（华
　　为）
　　17、给出某个一般时序电路的图，有Tsetup,Tdelay,Tck->q,还有 clock的delay,写出决
　　定最大时钟的因素，同时给出表达式。（威盛VIA 2003.11.06 上海笔试试题）
　　18、说说静态、动态时序模拟的优缺点。（威盛VIA 2003.11.06 上海笔试试题）
　　19、一个四级的Mux,其中第二级信号为关键信号 如何改善timing。（威盛VIA
　　2003.11.06 上海笔试试题）
　　20、给出一个门级的图，又给了各个门的传输延时，问关键路径是什么，还问给出输入，
　　使得输出依赖于关键路径。（未知）
　　21、逻辑方面数字电路的卡诺图化简，时序（同步异步差异），触发器有几种（区别，优
　　点），全加器等等。（未知）
　　22、卡诺图写出逻辑表达使。（威盛VIA 2003.11.06 上海笔试试题）
　　23、化简F(A,B,C,D)= m(1,3,4,5,10,11,12,13,14,15)的和。（威盛）
　　24、please show the CMOS inverter schmatic,layout and its cross sectionwith P-
　　well process.Plot its transfer curve (Vout-Vin) And also explain the
　　operation region of PMOS and NMOS for each segment of the transfer curve? （威
　　盛笔试题circuit design-beijing-03.11.09）
　　25、To design a CMOS invertor with balance rise and fall time,please define
　　the ration of channel width of PMOS and NMOS and explain?
　　26、为什么一个标准的倒相器中P管的宽长比要比N管的宽长比大？（仕兰微电子）
　　27、用mos管搭出一个二输入与非门。（扬智电子笔试）
　　28、please draw the transistor level schematic of a cmos 2 input AND gate and
　　explain which input has faster response for output rising edge.(less delay
　　time)。（威盛笔试题circuit design-beijing-03.11.09）
　　29、画出NOT,NAND,NOR的符号，真值表，还有transistor level的电路。（Infineon笔
　　试）

　　30、画出CMOS的图，画出tow-to-one mux gate。（威盛VIA 2003.11.06 上海笔试试题）
　　31、用一个二选一mux和一个inv实现异或。（飞利浦－大唐笔试）
　　32、画出Y=A*B+C的cmos电路图。（科广试题）
　　33、用逻辑们和cmos电路实现ab+cd。（飞利浦－大唐笔试）
　　34、画出CMOS电路的晶体管级电路图，实现Y=A*B+C(D+E)。（仕兰微电子）
　　35、利用4选1实现F(x,y,z)=xz+yz’。（未知）
　　36、给一个表达式f=xxxx+xxxx+xxxxx+xxxx用最少数量的与非门实现（实际上就是化
　　简）。
　　37、给出一个简单的由多个NOT,NAND,NOR组成的原理图，根据输入波形画出各点波形。
　　（Infineon笔试）
　　38、为了实现逻辑（A XOR B）OR （C AND D），请选用以下逻辑中的一种，并说明为什
　　么？1）INV 2）AND 3）OR 4）NAND 5）NOR 6）XOR 答案：NAND（未知）
　　39、用与非门等设计全加法器。（华为）
　　40、给出两个门电路让你分析异同。（华为）
　　41、用简单电路实现，当A为输入时，输出B波形为…（仕兰微电子）
　　42、A,B,C,D,E进行投票，多数服从少数，输出是F（也就是如果A,B,C,D,E中1的个数比0
　　多，那么F输出为1，否则F为0），用与非门实现，输入数目没有限制。（未知）
　　43、用波形表示D触发器的功能。（扬智电子笔试）
　　44、用传输门和倒向器搭一个边沿触发器。（扬智电子笔试）
　　45、用逻辑们画出D触发器。（威盛VIA 2003.11.06 上海笔试试题）
　　46、画出DFF的结构图,用verilog实现之。（威盛）
　　47、画出一种CMOS的D锁存器的电路图和版图。（未知）
　　48、D触发器和D锁存器的区别。（新太硬件面试）
　　49、简述latch和filp-flop的异同。（未知）
　　50、LATCH和DFF的概念和区别。（未知）
　　51、latch与register的区别,为什么现在多用register.行为级描述中latch如何产生的。
　　（南山之桥）
　　52、用D触发器做个二分颦的电路.又问什么是状态图。（华为）
　　53、请画出用D触发器实现2倍分频的逻辑电路？（汉王笔试）
　　54、怎样用D触发器、与或非门组成二分频电路？（东信笔试）
　　55、How many flip-flop circuits are needed to divide by 16? (Intel) 16分频？
　　56、用filp-flop和logic-gate设计一个1位加法器，输入carryin和current-stage，输出
　　carryout和next-stage. （未知）
　　57、用D触发器做个4进制的计数。（华为）
　　58、实现N位Johnson Counter,N=5。（南山之桥）
　　59、用你熟悉的设计方式设计一个可预置初值的7进制循环计数器，15进制的呢？（仕兰
　　微电子）
　　60、数字电路设计当然必问Verilog/VHDL，如设计计数器。（未知）
　　61、BLOCKING NONBLOCKING 赋值的区别。（南山之桥）
　　62、写异步D触发器的verilog module。（扬智电子笔试）
　　module dff8(clk , reset, d, q);
　　input clk;
　　input reset;
　　input [7:0] d;
　　output [7:0] q;
　　reg [7:0] q;
　　always @ (posedge clk or posedge reset)
　　if(reset)
　　q <= 0;
　　else
　　q <= d;
　　endmodule
　　63、用D触发器实现2倍分频的Verilog描述？ （汉王笔试）
　　module divide2( clk , clk_o, reset);
　　input clk , reset;
　　output clk_o;
　　wire in;
　　reg out ;
　　always @ ( posedge clk or posedge reset)
　　if ( reset)
　　out <= 0;
　　else
　　out <= in;
　　assign in = ~out;
　　assign clk_o = out;
　　endmodule
　　64、可编程逻辑器件在现代电子设计中越来越重要，请问：a) 你所知道的可编程逻辑器
　　件有哪些？ b) 试用VHDL或VERILOG、ABLE描述8位D触发器逻辑。（汉王笔试）
　　PAL，PLD，CPLD，FPGA。
　　module dff8(clk , reset, d, q);
　　input clk;
　　input reset;
　　input d;
　　output q;
　　reg q;
　　always @ (posedge clk or posedge reset)
　　if(reset)
　　q <= 0;
　　else
　　q <= d;
　　endmodule
　　65、请用HDL描述四位的全加法器、5分频电路。（仕兰微电子）
　　66、用VERILOG或VHDL写一段代码，实现10进制计数器。（未知）
　　67、用VERILOG或VHDL写一段代码，实现消除一个glitch。（未知）
　　68、一个状态机的题目用verilog实现（不过这个状态机画的实在比较差，很容易误解
　　的）。（威盛VIA 2003.11.06 上海笔试试题）
　　69、描述一个交通信号灯的设计。（仕兰微电子）
　　70、画状态机，接受1，2，5分钱的卖报机，每份报纸5分钱。（扬智电子笔试）
　　71、设计一个自动售货机系统，卖soda水的，只能投进三种硬币，要正确的找回钱
　　数。 （1）画出fsm（有限状态机）；（2）用verilog编程，语法要符合fpga设计
　　的要求。（未知）
　　72、设计一个自动饮料售卖机，饮料10分钱，硬币有5分和10分两种，并考虑找零：（1）
　　画出fsm（有限状态机）；（2）用verilog编程，语法要符合fpga设计的要求；（3）设计
　　工程中可使用的工具及设计大致过程。（未知）
　　73、画出可以检测10010串的状态图,并verilog实现之。（威盛）
　　74、用FSM实现101101的序列检测模块。（南山之桥）
　　a为输入端，b为输出端，如果a连续输入为1101则b输出为1，否则为0。
　　例如a： 0001100110110100100110
　　b： 0000000000100100000000
　　请画出state machine；请用RTL描述其state machine。（未知）
　　75、用verilog ddl检测stream中的特定字符串（分状态用状态机写）。（飞利浦－大唐
　　笔试）
　　76、用verilog hdl写一个fifo控制器(包括空，满，半满信号)。（飞利浦－大唐笔试）
　　77、现有一用户需要一种集成电路产品，要求该产品能够实现如下功能：y=lnx，其中，x
　　为4位二进制整数输入信号。y为二进制小数输出，要求保留两位小数。电源电压为3~5v假
　　设公司接到该项目后，交由你来负责该产品的设计，试讨论该产品的设计全程。（仕兰微
　　电子）
　　78、sram，falsh memory，及dram的区别？（新太硬件面试）
　　79、给出单管DRAM的原理图(西电版《数字电子技术基础》作者杨颂华、冯毛官205页图9
　　－14b)，问你有什么办法提高refresh time，总共有5个问题，记不起来了。（降低温
　　度，增大电容存储容量）（Infineon笔试）
　　80、Please draw schematic of a common SRAM cell with 6 transistors,point out
　　which nodes can store data and which node is word line control? （威盛笔试题
　　circuit design-beijing-03.11.09）
　　81、名词:sram,ssram,sdram
　　名词IRQ,Bios,USB,VHDL,SDR
　　IRQ: Interrupt ReQuest
　　BIOS: Basic Input Output System
　　USB: Universal Serial Bus
　　VHDL: VHIC Hardware Description Language
　　SDR: Single Data Rate 参考技术A 一、填空(15分)
1. 电压互感器的一次组 联接入被测电路，运行中其二次绕组不允许_____路。
2.开关电器加速电弧熄灭的方法有 、
、 和 。
3.隔离开关的作用是 、 和 。
4.电气设备的预防性试验可分为 性试验和 性试验两大类。
5.电介质极化的形式主要有 式极化、 式极化、
式极化和 极化。
6.配电装置可分为 式配电装置、 式配电装置和成套式配电装置。
7.选择隔离开关时应考虑的选择与校验项目有：按型式选择、
按 选择、按 选择、校验 、校验 、校验 。
8.输电线路的停电操作步骤是：首先拉开 ；再拉开 ；最后拉开 。
9.两台变压器并联运行的条件是两台变压器的 、
和 。
10.发电厂自用电率为发电厂 与
。
二、单择题（10分）
1.熔断器额定电流是指熔断器的（ ）部分允许通过的最大长期工作电流。
A．熔管。B．熔件。C．熔管、载流部分和底座。D. 载流部分和底座。
2.变压器正常过负荷是根据高峰负荷时过负荷绝缘寿命损失增加，低负荷时绝缘寿命损失减少，在两者相互补偿使变压器总的寿命损失（ ）条件确定的。
A．不加大。B．略加大。C.略减小。
3.选择断路器时，应要求断路器的额定开断电流（ ）断路器开断时所通过的最大短路电流。
A．不大于。B．不小于。C．小于。D.大于。
4. 断路器控制回路中，防跳继电器的作用是（ ）。
A．防止断路器跳跃。B．防止断路器跳跃和保护继电保护装置的出口继电器触点。C．防止断路器跳闸时间过长。D. 防止断路器跳跃和防止断路器合闸时间过长。
5.同一相母线中绝缘子之间的距离（ ）临界垮距时，其动稳定合格。
A．不大于。B．小于。C．大于。D. 不小于。
三、名词解释（15分）
1.熔断器的极限断路电流：
2.断路器的分闸时间：
3.断路器的额定开断电流：
4.行波：
5.母线的最小允许截面：
四、问答题（20分）
1.什么是I类厂用负荷？ I类厂用负荷对供电电源有哪些要求。
2.什么是变压器绝缘老化的6C规则。
3.简述使用三相电压表进行进行交流绝缘监察的工作原理。
4.运行中电流互感器器什么不允许开路。
5.摇表的工作原理。
五、绘图题（24分）
1.绘出具有2个电源、3个引出线的单母线带旁路的主接线图。
2.绘出内桥式接线的主接线图。
3.绘出 10kV三相五柱式电压互感器的接线。
4.绘出两相是式电流互感器接线，并标出三相电流路经。
六、选择测量用电流互感器的条件。（8分）
七、某电气设备直径为5m，高17m。欲在距该设备边缘7m处安装1支独立避雷针对设备进行直击雷保护，请选择避雷针高度。（8分）
“发电厂电气主系统试题”A
答案
一、填空(15分)
1. 并。短。
2.气体吹动。多断口。电弧与固体介质接触。金属灭弧栅。
3.隔离电压。切换电路。拉合小电流。
4.破坏。非破坏。
5.电子。离子。耦极子。夹层。
6.屋内。屋外。
7.额定电压。额定电流。机械负荷。动稳定。热稳定。
8.断路器。线路隔离开关。母线隔离开关。
9.接线组别相同。变比相同。短路电压相同。
10.同一时间内发电厂自用电。发电厂的发电量之比。
二、单择题（10分）
1. C。2.A。3.B。4.B。5.A。
三、名词解释（15分）
1.熔断器的极限断路电流：是指其能够可靠切断的最大电流。
2.断路器的分闸时间：处于合闸状态的断路器，从分闸回路接受分闸命令(脉冲)瞬间起，直到所有灭弧触头均分离瞬间的时间间隔。
3.断路器的额定开断电流：断路器在频率为50Hz的瞬态恢复电压下， 能够开断的最大短路电流值。
4. 行波：沿导线传播的电压波、电流波统称为行波，其实质是电磁能量沿导线传播。
5．母线的最小允许截面：短路电流通过母线后母线的温度恰好升高到短路时最高允许时,所要求最小的母线截面积。
四、问答题（20分）
1. I类厂用负荷对供电有何要求？
答：Ⅰ类负荷指短时(即手动切换恢复供电所需的时间)的停电可能影响人身或设备安全，使生产停顿或发电量大量下降的负荷。Ⅰ类负荷应由两个独立电源供电，当一个电源消失后，另一个电源要立即自动投入继续供电。为此, Ⅰ类负荷的电源应配置备用电源自动投入装置。
2. 什么是变压器绝缘老化的6C规则。
答：变压器绕组的温度每增加6C，其使用年限将减少一半的规则。
3.简述使用三相电压表进行进行交流绝缘检察的工作原理。
答：小电流接地系统绝缘在正常或发生接地时，各相对地电压不同。当系统绝缘在正常时，各相对地电压等于电源的相电压；当系统绝缘损坏发生一相金属性接地时，故障相对地电压为零，而其它两相对地电压将升至到电源的线电压。因此，可利用电压表（经电压互感器）测量系统三相对地电压，根据各相对地电压的变化监视交流系统的绝缘状况。
4.运行中电流互感器器什么不允许开路。
答：电流互感器正常工作时，二次回路近于短路状态。这时二次电流所产生的二次绕组磁动势F2对一次绕组磁动势F1有去磁作用，因此合成磁势F0＝F1-F2不大，合成磁通φ0也不大，二次绕组内感应电动势E2的数值最多不超过几十伏。因此，为了减少电流互感器的尺寸和造价，互感器铁心的截面是根据电流互感器在正常工作状态下合磁磁通φ0很小而设计的。
使用中的电流互感器如果发生二次回路开路，二次绕组磁动势F2等于零，一次绕组磁动势F1仍保持不变，且全部用于激磁，合成磁势F0=F1，这时的F0较正常时的合成磁势(F1-F2)增大了许多倍，使得铁心中的磁通急剧地增加而达到饱和状态。由于铁心饱和致使磁通波形变为平顶波，因为感应电动势正比于磁通的变化率dφ/dt，所以这时二次绕组内将感应出很高的感应电动势e2。二次绕组开路时二次绕组的感应电动势e2是尖顶的非正弦波，其峰值可达数千伏之高，这对工作人员和二次设备以及二次电缆的绝缘都是极危险的。另一影响是，因铁心内磁通的剧增，引起铁心损耗增大，造成严重发热也会使电流互感器烧毁。第三个影响是因铁心剩磁过大，使电流互感器的误差增加。
5.摇表的工作原理。
答：摇表（兆欧表）是由电源（发电机G）和磁电系流比计（测量机构）等组成，其原理接线如下图所示，图中G为发电机，RA、RV分别为流比计电流线圈LA和电压线圈LV相串联的固定电阻。

摇表（兆欧表）原理接线
直流发电机的电压加至两个并联的电流线圈和电压线圈回路，其中被测电阻串入电流线圈回路（接在E、L端子之间）。由于磁电系流比计处于不均匀磁场中，所以两个线圈所受力与线圈在磁场中所处位置有关。因为两个线圈绕制的方向不同，当两个线圈中通过电流时会产生不同方向的转动力矩。在两个线圈力矩差的作用下，使其转动部分带动指针转动，两个线圈所受力矩也随之改变，只有转动到力矩差为零时才停止转动。显然，指针的偏转角与并联电路中的电流比值有关，即：
I1
=f(———)
I2
式中 I1—电流线圈LA中的电流；
I2—电压线圈LV中的电流
由于并联支路电流的分配与其电阻值成反比，所以偏转角的大小反映了被测电阻值的大小。兆欧表在额定电压下，I2为一定值，但被测电阻Ri与电流线圈LA相串联，所以I1的大小随Ri转的数值而改变，于是Ri的大小决定了指针偏转角的位置。因此，在摇表的刻度盘上,便可直接读取被测品的绝缘电阻值。
五、绘图题（24分）
1.绘出具有2个电源、3个引出线的单母线带旁路的主接线图。

2.绘出内桥是式接线的主接线图。
答案参见教材图2—9(a）。
3.绘出 10kV三相五柱式电压互感器的接线。
答案参见教材图1—65（e）。
4.绘出两相式电流互感器接线，并标出三相电流。
答案参见教材图1—60(c）。
六、选择测量用电流互感器的条件。（8分）
答：1.型式的选择：根据电流互感器安装的场所和使用条件，选择电流互感器的绝缘结构、安装方式、结构型式等。
2.按额定电压选择：要求电流互感器的额定电压不小于装设电流互感器回路所在电网的额定电压。
3.按额定电流选择：要求电流互感器的一次额定电流不小于装设电抗器回路的最大持续工作电流。
4.按准确度级选择：要求电流互感器的准确度级应符合其二次测量仪表对准确度的要求。
5.校验二次负荷：要求电流互感器的二次负荷不超过规定准确度下所允许的最大负荷。
6.校验热稳定：要求电流互感器允许的热效应（即电流互感器的热稳定倍数K h与电流互感器一次额定电流乘积的平方再乘以t）不小于短路电流的热效应。
7.校验动稳定
(1)校验互感器内部动稳定的条件是互感器允许通过的极限电流（峰值）不小于通过互感器的最大三相冲击短路电流（峰值）。
(2)校验电流互感器外部动稳定，要求电流互感器电流互感器一次侧端部的允许作用力不小于电流互感器一次侧瓷绝缘端部所受的最大电动力。
七、某电气设备直径为5m，高17m。欲在距该设备边缘7m处安装1支独立避雷针对设备进行直击雷保护，请选择避雷针高度。（8分）
解：C点为安装避雷针的地点，图中A点为距避雷针保护的最远点，故hx=17m,rx=12m。
假设避雷针高度为h，且hXh/2、h30m。

根据单支避雷针保护范围计算公式rx=(h-hx)P的关系，选取 避雷针高度h=(rx/P)+ hx=(12/1)+17=29m
计算结果与假设相符，取h29m
hX=17m时的保护半径为：rX1=(h-hX)P=(29-17)1=12m
取h29m时，电气设备在避雷针的保护范围之内，故选 参考技术B 数字电路
1、同步电路和异步电路的区别是什么？（仕兰微电子）
2、什么是同步逻辑和异步逻辑？（汉王笔试）
同步逻辑是时钟之间有固定的因果关系。异步逻辑是各时钟之间没有固定的因果关系。
3、什么是"线与"逻辑，要实现它，在硬件特性上有什么具体要求？（汉王笔试）
线与逻辑是两个输出信号相连可以实现与的功能。在硬件上，要用oc门来实现，由于不用
oc门可能使灌电流过大，而烧坏逻辑门。
同时在输出端口应加一个上拉电阻。
4、什么是Setup
和Holdup时间？（汉王笔试）
5、setup和holdup时间,区别.（南山之桥）
6、解释setup
time和hold
time的定义和在时钟信号延迟时的变化。（未知）
7、解释setup和hold
time
violation，画图说明，并说明解决办法。（威盛VIA
2003.11.06
上海笔试试题）
Setup/hold
time
是测试芯片对输入信号和时钟信号之间的时间要求。建立时间是指触发
器的时钟信号上升沿到来以前，数据稳定不变的时间。输入信号应提前时钟上升沿（如上升沿有效）T时间到达芯片，这个T就是建立时间-Setup
time.如不满足setup
time,这个数据就不能被这一时钟打入触发器，只有在下一个时钟上升沿，数据才能被打入触发器。
保持时间是指触发器的时钟信号上升沿到来以后，数据稳定不变的时间。如果hold
time
不够，数据同样不能被打入触发器。
建立时间(Setup
Time)和保持时间（Hold
time）。建立时间是指在时钟边沿前，数据信
号需要保持不变的时间。保持时间是指时钟跳变边沿后数据信号需要保持不变的时间。如果不满足建立和保持时间的话，那么DFF将不能正确地采样到数据，将会出现
metastability的情况。如果数据信号在时钟沿触发前后持续的时间均超过建立和保持时
间，那么超过量就分别被称为建立时间裕量和保持时间裕量。
8、说说对数字逻辑中的竞争和冒险的理解，并举例说明竞争和冒险怎样消除。（仕兰微
电子）
9、什么是竞争与冒险现象？怎样判断？如何消除？（汉王笔试）
在组合逻辑中，由于门的输入信号通路中经过了不同的延时，导致到达该门的时间不一致叫竞争。产生毛刺叫冒险。如果布尔式中有相反的信号则可能产生竞争和冒险现象。解决方法：一是添加布尔式的消去项，二是在芯片外部加电容。
10、你知道那些常用逻辑电平？TTL与COMS电平可以直接互连吗？（汉王笔试）
常用逻辑电平：12V，5V，3.3V；TTL和CMOS不可以直接互连，由于TTL是在0.3-3.6V之间，而CMOS则是有在12V的有在5V的。CMOS输出接到TTL是可以直接互连。TTL接到CMOS需要在输出端口加一上拉电阻接到5V或者12V。
11、如何解决亚稳态。（飞利浦－大唐笔试）
亚稳态是指触发器无法在某个规定时间段内达到一个可确认的状态。当一个触发器进入亚
稳态时，既无法预测该单元的输出电平，也无法预测何时输出才能稳定在某个正确的电平
上。在这个稳定期间，触发器输出一些中间级电平，或者可能处于振荡状态，并且这种无
用的输出电平可以沿信号通道上的各个触发器级联式传播下去。
12、IC设计中同步复位与
异步复位的区别。（南山之桥）
13、MOORE
与
MEELEY状态机的特征。（南山之桥）
14、多时域设计中,如何处理信号跨时域。（南山之桥）
15、给了reg的setup,hold时间，求中间组合逻辑的delay范围。（飞利浦－大唐笔试）
Delay
<
period
-
setup
–
hold
16、时钟周期为T,触发器D1的建立时间最大为T1max，最小为T1min。组合逻辑电路最大延
迟为T2max,最小为T2min。问，触发器D2的建立时间T3和保持时间应满足什么条件。（华
为）
17、给出某个一般时序电路的图，有Tsetup,Tdelay,Tck->q,还有
clock的delay,写出决
定最大时钟的因素，同时给出表达式。（威盛VIA
2003.11.06
上海笔试试题）
18、说说静态、动态时序模拟的优缺点。（威盛VIA
2003.11.06
上海笔试试题）
19、一个四级的Mux,其中第二级信号为关
查看原帖>> 参考技术C 我找不到! 要对自己有信心!给你最好的祝福!

工作顺利.......

练习10.11｜Maven相关笔试面试题目

上期题目解答 ：

1.下列说法正确的是（）

A.一个文件里可以同时存在两个public修饰的类
B.构造函数可以被重写（override）
C.子类不能访问父类非public和protected修饰的属性
D.final修饰的类可以被继承

解答：一个Java源文件中最多只能有一个public类，当有一个public类时，源文件名必须与之一致，否则无法编译，如果源文件中没有一个public类，则文件名与类中没有一致性要求。至于main()不是必须要放在public类中才能运行程序。

重写是子类继承父类后对父类的方法进行修改。方法名，参数，返回值必须一样。 不能重写被标示为final的方法。如果不能继承一个方法，则不能重写这个方法。

扩展：重写override，重载overload的区别

Java的方法重载

就是在类中可以创建多个方法，它们具有相同的名字，但具有不同的参数和不同的定义。调用方法时通过传递给它们的不同参数个数和参数类型来决定具体使用哪个方法,而且返回值类型可以相同也可以不相同，这也是面向对象的多态性。

Java的方法重写

父类与子类之间的多态性，对父类的函数进行重新定义。如果在子类中定义某方法与其父类有相同的名称和参数，我们说该方法被重写 (Overriding)。在Java中，子类可继承父类中的方法，而不需要重新编写相同的方法。但有时子类并不想原封不动地继承父类的方法，而是想作一定的修改，这就需要采用方法的重写。方法重写又称方法覆盖。

若子类中的方法与父类中的某一方法具有相同的方法名、返回类型和参数表，则新方法将覆盖原有的方法。如需父类中原有的方法，可使用super关键字，该关键字引用了当前类的父类。

子类函数的访问修饰权限不能少于父类的；

重写方法只能存在于具有继承关系中，重写方法只能重写父类非私有的方法。

2.for(int x=0,y=0;(y!=0)&&(x<4);x++)循环的执行次数是（）

A.无限次
B.执行4次
C.执行3次
D.一次也不执行

解答：y初始值为0，在整个for循环中，y的值不变，故判断语句中的(y!=0)不成立，故一次也不执行。

3.在使用super 和this关键字时，以下描述正确的是（）

A.在子类构造方法中使用super（）显示调用父类的构造方法；super（）必须写在子类构造方法的第一行，否则编译不通过
B.super（）和this（）不一定要放在构造方法内第一行
C.this（）和super（）可以同时出现在一个构造函数中
D.this（）和super（）可以在static环境中使用，包括static方法和static语句块

解答：Java关键字this只能用于方法方法体内。当一个对象创建后，Java虚拟机（JVM）就会给这个对象分配一个引用自身的指针，这个指针的名字就是this。因此，this只能在类中的非静态方法中使用，静态方法和静态的代码块中绝对不能出现this。

super关键和this作用类似，是被屏蔽的成员变量或者成员方法或变为可见，或者说用来引用被屏蔽的成员变量和成员成员方法。

不过super是用在子类中，目的是访问直接父类中被屏蔽的成员，注意是直接父类（就是类之上最近的超类）

4.下面哪个流类属于面向字符的输入流(  )

A、BufferedWriter

B、FileInputStream

C、ObjectInputStream

D、InputStreamReader

解答：Java的IO操作中有面向字节(Byte)和面向字符(Character)两种方式。

面向字节的操作为以8位为单位对二进制的数据进行操作，对数据不进行转换，这些类都是InputStream和OutputStream的子类。

面向字符的操作为以字符为单位对数据进行操作，在读的时候将二进制数据转为字符，在写的时候将字符转为二进制数据，这些类都是Reader和Writer的子类。

5.下列哪个叙述是正确的（）

A.子类继承父类的构造方法。
B.abstract类的子类必须是非abstract类。
C.子类继承的方法只能操作子类继承和隐藏的成员变量。
D.子类重写或新增的方法也能直接操作被子类隐藏的成员变量。

解答：子类是不继承父类的构造方法的，而是必须调用其父类的构造方法。
abstract类的子类可以是abstract类，如果是非abstract类，就必须重写父类中所有的abstract方法。
D中子类新增的方法是不能直接操作被子类隐藏的成员变量的。

6.当检索一个压缩文件时，首先要建立压缩文件输入流对象，该对象（）

A、以选中的压缩文件为参数

B、以FileInputStream对象为参数

C、以InputStreamReader对象为参数

D、以BufferedReader对象为参数

解答：在java.io包中提供了对压缩文件进行操作的能力。它是通过压缩文件输入流与压缩文件输出流来实现的，其分别继承自InflaterInputStream与DeflaterOutputStream。

在创建压缩文件输入流时，其初始化参数是一个FileInputStream类的实例。

7.已知一个有序线性表为（）(13，18，24，35，47，50，62，83，90，115，134)，当用二分法查找值为90的元素时，查找成功的比较次数为( ）

A，1         B，2       C，3       D，9

解答：根据二分法查找需要两次：首先将90与表中间的元素50进行比较，由于90大于50，所以在线性表的后半部分查找；第二次比较的元素是后半部分的中间元素，即90，这时两者相等，即查找成功。

8.下列选项中，不属于模块间耦合的是( )

A.数据耦合
B.标记耦合
C.异构耦合
D.公共耦合

解答：模块之间的耦合程度反映了模块的独立性，也反映了系统分解后的复杂程度。 按照耦合程度从弱到强，可以将其分成7级。

分别是非直接耦合、数据耦合、标记耦合、控制 耦合、外部耦合、公共耦合和内容耦合。其中没有异构耦合这种方式。

9.下列关于线程优先级的说法中，正确的是（）

A、线程的优先级是不能改变的
B、线程的优先级是在创建线程时设置的
C、在创建线程后的任何时候都可以设置
D、B和C

解答：Java语言中线程的优先级是用一个介于MIN_PRIORITY和MAX_PRIORITY之间的整数来表示的。可以在创建线程后的任何时候修改线程的优先级。

10.下列关于构造方法的叙述中，错误的是（）

A、Java语言规定构造方法名与类名必须相同

B、Java语言规定构造方法没有返回值，但不用void声明

C、Java语言规定构造方法不可以重载

D、Java语言规定构造方法通常通过new自动调用

构造方法：用于完成对象属性的初始化工作，有如下特点：

（1）构造方法的名字必须和类名完全一样（包括大小写）；

（2）构造方法没有返回值，连void也不会出现；

（3）如果认为没有给类创建一个构造方法，java编译器会自动给我们添加一个没有参数且方法体为空的构造方法。当然，如果已经人为的添加了一个构造方法，java编译器就不会给添加这个构造方法了。

（4）我们不能显式调用类的构造方法，构造方法通常只是通过new关键字隐式调用；

本期题目 ：Maven基础相关      难度指数：★★

1.Maven有哪些优点和缺点

2.什么是Maven坐标

3.Maven常见的依赖范围有哪些?

4.Maven的生命周期

5.我们经常使用“Mvn Clean Package”命令进行项目打包，请问该命令执行了哪些动作来完成该任务？

6.依赖的解析机制

7.插件的解析机制

8.对于一个多模块项目，如果管理项目依赖的版本

9.常见的Maven私服的仓库类型

10.多模块如何聚合

书籍推荐：入门级    难度指数：★★★

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