FPGA学习-2:开发板及Verilog介绍
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篇首语:本文由小常识网(cha138.com)小编为大家整理,主要介绍了FPGA学习-2:开发板及Verilog介绍相关的知识,希望对你有一定的参考价值。
我们将使用sipeed公司设计的tang permier开发板进行开发学习
这款开发板使用了国产EG4S20芯片
拥有2万多个逻辑门单元
价格仅100多,极具性价比
可以在上面跑riscv开源架构cpu核心
完全够用
IDE我们使用官方的安路TD软件
详细安装过程可去sipeed文档上查看
与开发程序类似
开发FPGA同样有编程语言
比如verilog,VHDL
这里使用verilog作为核心开发语言
如果你对C语言有一定的了解,有助于Verilog的快速上手。
下面是一个简单的计数器
module top(
input clk,
output reg[15:0] out_cnt
);
initial begin
out_cnt = 16\'b0;
end
always@(clk) begin
if (out_cnt == 16\'d250)begin
out_cnt =0;
end
else begin
out_cnt = out_cnt + 16\'b1;
end
end
endmodule
verilog语言主要以模块为单位来描述一个电路结构
描述电路的方式有行为级描述,数据流描述,结构化描述
越往后难度越高,更接近于原始电路设计,但逻辑控制越简单
verilog将复杂的电路功能抽象为一个个模块(module)
通过组合个各个模块来完成不同的电路
并且verilog采用自顶向下的方式进行程序设计
一步步完成各个模块再进行组合即完成一个基本的FPGA项目
以上是关于FPGA学习-2:开发板及Verilog介绍的主要内容,如果未能解决你的问题,请参考以下文章
基于vivado(语言Verilog)的FPGA学习——FPGA理论知识
FPGA教程案例55深度学习案例2——基于FPGA的CNN卷积神经网络之ReLu激活层verilog实现
FPGA教程案例57深度学习案例4——基于FPGA的CNN卷积神经网络之卷积层verilog实现
FPGA教程案例58深度学习案例5——基于FPGA的CNN卷积神经网络之图像缓存verilog实现