fpga设计和ic设计相比较如何，那个更有发展前景?

Posted 2021-06-11 IC设计_云一哥

fpga设计和ic设计相比

往小了说，要看你选择的具体是哪个方向岗位，毕竟进入行业你要以哪个点当做入门票也很重要。

往大了说，将来你要是走更远，要成为大佬，那基本各个方向的都要有涉及的。

不同方向，代表你要去两个不同的公司发展，在发展前景上差距不是很大，因为你终将要成为大佬，目前在薪资上IC设计要比FPGA要高一点（但每个行业都有佼佼者，大佬级人物，所以薪资在这些人身上基本是一个水平线）。

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这里来对比下，FPGA和ic设计的Asic吧，你可以酌情选择

个头大：FPGA要个头大得多才能实现ASIC相同的功能,主频还只有几分之一，因此，FPGA设计的芯片个头相对于ASIC设计的芯片个头来说还是大很多的。芯片大证明了什么就不用说了吧！

功耗大：FPGA尤其是基于占用大量硅面积的、每个单元六个晶体管的静态存储器（SRAM）的查寻表（LUT）和配置元件技术的FPGA，其功耗要比对等的ASIC大得多。

流片费用：FPGA贵在单片，开发工具和风险基本不存在。对于ASIC贵在流片的费用和开发工具，除非你的芯片一次成功可以量产，否则单片费用将其贵无比！

商用价值：ASIC用于大型项目，适用于设计规模特别大的项目。而对于需要快速投放市场且支持远程升级的小型项目，FPGA则更为适合。

在看看网友对FPGA比ASIC的理解

FPGA的LUT等资源已经固定了，你用不用都在那里，不多不少。

ASIC理论上每一个你用到的CELL或者IP等资源你都可以手动的摆放来进行优化。

FPGA的资源固定有两个劣势：

劣势一：能够利用的资源是固定的，且不成大片，横跨区域的产生逻辑，会退化时序。其实也就是你没有办法把逻辑尽可能的摆得近。逻辑摆得近可以减小线上的延迟，可以提高速度。ASIC的cell你可以全部的挤在一起（不违反DRC的前提下）。

劣势二：你的大小是固定的。你用1个门还是用10W个门，都是这一片已经固定好了的LUT给你用。如果你的逻辑很小很小，FPGA很大，你信号从IO进来到逻辑，有可能会走比较长的距离，这个也要花时间的。极端的例子，你从上部的IO进来，你的逻辑在下部，这走线的长度感人啊。（正常的设计不会这么做的）。

除此之外，FPGA的走线，你几乎是动不了的。

ASIC中你可以直接加宽金属线，比如两倍宽度走时钟线，复位线啦，之类的。金属线宽度变大，线上的延迟变小，对速度也是有帮助的。

还有asic的库一般还包含高性能cell，低功耗cell等。在关键路径，为了提高时序，你全用高性能的cell（功耗大）。一般的路径，时序比较松，多用低功耗的cell（性能低）。你FPGA一旦选定了，你就只有他给你的东西，你没有选的。

ASIC还可以使用useful skew的方式来提高速度，手段会比FPGA中的多。

总的来说，就如同GPU和CPU一样。GPU可以非常快的处理图像，但是让GPU去处理其他的东西，GPU表示摊手。CPU很多的运算都能处理，也能去处理图像，只是慢而已。一旦你是冲着某个目的去的（ASIC）你为了实现这个目标，你各种没节操没下线都可以。如果你想要多方面兼顾(FPGA)，你就不可能在每一个方面都做到最好，你必须trade-off。

在来说下选FPGA还是选IC设计？

在我个人是比较倾向ic设计的，不管是兴趣，还是薪资发展，都要比现在的FPGA要有一定的优势。

希望可以帮助到你。