FPGA的学习:数码管动态显示的实现

Posted 石小舟

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篇首语:本文由小常识网(cha138.com)小编为大家整理,主要介绍了FPGA的学习:数码管动态显示的实现相关的知识,希望对你有一定的参考价值。

最后进行仿真。

`timescale  1ns/1ns
module  tb_top_seg_595();
//wire  define
wire    stcp    ;   //输出数据存储寄时钟
wire    shcp    ;   //移位寄存器的时钟输入   
wire    ds      ;   //串行数据输入
wire    oe      ;   //输出使能信号

//reg   define
reg     sys_clk     ;
reg     sys_rst_n   ;
//对sys_clk,sys_rst_n赋初始值
initial
    begin
        sys_clk     =   1'b1;
        sys_rst_n   <=  1'b0;
        #100
        sys_rst_n   <=  1'b1;
    end

//clk:产生时钟
always  #10 sys_clk <=  ~sys_clk;

//重新定义参数值,缩短仿真时间
defparam  top_seg_595_inst.seg_595_dynamic_inst.seg_dynamic_inst.CNT_MAX=19;
defparam  top_seg_595_inst.data_gen_inst.CNT_MAX    =   49;
//------------- seg_595_static_inst -------------
top_seg_595  top_seg_595_inst
(
    .sys_clk     (sys_clk   ),  //系统时钟,频率50MHz
    .sys_rst_n   (sys_rst_n ),  //复位信号,低电平有效

    .stcp        (stcp      ),   //输出数据存储寄时钟
    .shcp        (shcp      ),   //移位寄存器的时钟输入
    .ds          (ds        ),   //串行数据输入
    .oe          (oe        )    //输出使能信号
);

endmodule

以上是关于FPGA的学习:数码管动态显示的实现的主要内容,如果未能解决你的问题,请参考以下文章

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