FPGA软件使用

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篇首语:本文由小常识网(cha138.com)小编为大家整理,主要介绍了FPGA软件使用相关的知识,希望对你有一定的参考价值。

目录

1.关联出错问题

quartus ii和modelsim关联出错解决方式亲测有效

2.modelsim波形


ctrl+a,全选;ctrl+g,智能分组;

3.modelsim通过Quartus ll打开后不显示波形

不仅不显示波形甚至连processes中的tb文件啥的都没有,很大可能性是代码敲错了,可以再检查一下代码是否有问题,Quartus ll中有时候没报错,但是modelsim,无法显示波形;

4.modelsim中的wave可以只显示信号名字

点图中勾出来的小黑点即可

5.modelsim中的wave中的符号含义

这里这个x是指,信号f未定义

6.quartus中出现名字不同的错误


处理方式:
files—>文件—>右击—>Set as Top-Level Entity,设置一下即可

7.Verilog语言

posedge是上升沿,电平从低到高跳变
negedge是下降沿,电平从高到低跳变

8.初学者可以看看

DID 迪------牛逼大佬求带
CSDN上的一个大佬,他写的FPGA学习笔记,虽然不多,但是初学者看着很亲切,很详细!给大佬跪了

9.计数器的计算

9.1.计算

学习板上晶振为50MHz,也就是说时钟周期为 20ns , 这样可以计算得出 500ms = 500_000_000ns/20,即需要计数器 计数 25_000_000 次,也就是需要一个至少 25 位的计数器( 位的计数器( 225>25_000_000>224 )。且每当计数次达到需要清零并重新计数。

9.2.计数器

计数器
这个大佬问答方式回答的也不错

9.3modelsim报告语法错误


别怀疑,从他报错的这个地方,往上扒拉,一定有语法错误!!!
代码不规范,两小时白干!!!!!

以上是关于FPGA软件使用的主要内容,如果未能解决你的问题,请参考以下文章

FPGA教程案例51控制案例3——基于FPGA的PWM波形产生verilog实现

FPGA的学习:数码管静态显示的实现

FPGA-vivado仿真导出波形文件

基于FPGA的DDS波形发生器可以用modelsim进行功能仿真吗?

fpga输出高电平准确为几V?

FPGA综合实验 03 - | 8位硬件乘法器设计